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デュアルチャンネル : ミニ英和和英辞書
デュアルチャンネル
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〔語彙分解〕的な部分一致の検索結果は以下の通りです。


デュアルチャンネル ( リダイレクト:デュアルチャネルまたはデュアルチャンネルは、広義には同一の規格の通信インターフェイスを二重に備えること。狭義としてはパソコンに搭載されているランダムアクセスメモリ(RAM)の規格において、DDR SDRAM、DDR2 SDRAM、DDR3 SDRAMに対応したマザーボードを用い、メモリとノースブリッジ間(メモリバス)のデータの転送速度を二倍に引き上げる技術である。また、3〜4枚一組のDDR3 SDRAMを使用するトリプルチャネルやクアッドチャネルも存在する。本項では狭義について述べる。== 誕生の経緯 ==本規格の誕生は1999年にインテルが発表したDirect Rambus DRAM に端を発する。RDRAMは技術的断絶を必要としたため一般普及に失敗した経緯を持ち、インテルはDRDRAM の転送速度に代替手段を相対的に低速なSDRAM系技術に求めた。元来はPentium 4のメモリ転送能力要求に見合う速度を必要として誕生した技術であったが、同社の Intel 865 chipset に DDR2 SDRAM インターフェイスを2つ並列で実装される事となる。 ) : ウィキペディア日本語版
デュアルチャネルまたはデュアルチャンネルは、広義には同一の規格の通信インターフェイスを二重に備えること。狭義としてはパソコンに搭載されているランダムアクセスメモリ(RAM)の規格において、DDR SDRAM、DDR2 SDRAM、DDR3 SDRAMに対応したマザーボードを用い、メモリとノースブリッジ間(メモリバス)のデータの転送速度を二倍に引き上げる技術である。また、3〜4枚一組のDDR3 SDRAMを使用するトリプルチャネルやクアッドチャネルも存在する。本項では狭義について述べる。== 誕生の経緯 ==本規格の誕生は1999年にインテルが発表したDirect Rambus DRAM に端を発する。RDRAMは技術的断絶を必要としたため一般普及に失敗した経緯を持ち、インテルはDRDRAM の転送速度に代替手段を相対的に低速なSDRAM系技術に求めた。元来はPentium 4のメモリ転送能力要求に見合う速度を必要として誕生した技術であったが、同社の Intel 865 chipset に DDR2 SDRAM インターフェイスを2つ並列で実装される事となる。

デュアルチャネルまたはデュアルチャンネルは、広義には同一の規格の通信インターフェイスを二重に備えること。狭義としてはパソコンに搭載されているランダムアクセスメモリ(RAM)の規格において、DDR SDRAMDDR2 SDRAMDDR3 SDRAMに対応したマザーボードを用い、メモリとノースブリッジ間(メモリバス)のデータの転送速度を二倍に引き上げる技術である。また、3〜4枚一組のDDR3 SDRAMを使用するトリプルチャネルやクアッドチャネルも存在する。
本項では狭義について述べる。
== 誕生の経緯 ==
本規格の誕生は1999年にインテルが発表したDirect Rambus DRAM に端を発する。RDRAMは技術的断絶を必要としたため一般普及に失敗した経緯を持ち、インテルはDRDRAM の転送速度に代替手段を相対的に低速なSDRAM系技術に求めた。元来はPentium 4のメモリ転送能力要求に見合う速度を必要として誕生した技術であったが、同社の Intel 865 chipset に DDR2 SDRAM インターフェイスを2つ並列で実装される事となる。

抄文引用元・出典: フリー百科事典『 ウィキペディア(Wikipedia)
ウィキペディアで「デュアルチャネルまたはデュアルチャンネルは、広義には同一の規格の通信インターフェイスを二重に備えること。狭義としてはパソコンに搭載されているランダムアクセスメモリ(RAM)の規格において、DDR SDRAM、DDR2 SDRAM、DDR3 SDRAMに対応したマザーボードを用い、メモリとノースブリッジ間(メモリバス)のデータの転送速度を二倍に引き上げる技術である。また、3〜4枚一組のDDR3 SDRAMを使用するトリプルチャネルやクアッドチャネルも存在する。本項では狭義について述べる。== 誕生の経緯 ==本規格の誕生は1999年にインテルが発表したDirect Rambus DRAM に端を発する。RDRAMは技術的断絶を必要としたため一般普及に失敗した経緯を持ち、インテルはDRDRAM の転送速度に代替手段を相対的に低速なSDRAM系技術に求めた。元来はPentium 4のメモリ転送能力要求に見合う速度を必要として誕生した技術であったが、同社の Intel 865 chipset に DDR2 SDRAM インターフェイスを2つ並列で実装される事となる。」の詳細全文を読む




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