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翻訳と辞書　辞書検索 [ 開発暫定版 ] スポンサード リンク メモリインタリーブ ： ミニ英和和英辞書 メモリインタリーブ[ちょうおん] ===================================== 〔語彙分解〕的な部分一致の検索結果は以下の通りです。 ・ ー ： [ちょうおん] 　(n) long vowel mark (usually only used in katakana) メモリインタリーブ （ リダイレクト：メモリインターリーブ（）とは、主記憶装置とCPUとの間のデータ転送を高速化する方法の一つである。CPUの処理速度と比較し、主記憶装置へのアクセス時間は遅い。そのため、CPUからのデータ転送要求が行われてから実際にデータが転送終了されるまでの間、処理が待たされることになり、CPUの処理能力を十分に発揮できない。それを解消するために、主記憶装置を複数のメモリバンクに分割し、CPUからのデータ転送要求を同時に（またはごく短いタイムラグをはさんで）複数のメモリバンクに発行する。それにより、CPUの待ち時間を極小化し、高速化することができる。2010年現在のパソコンで広く使われているデュアルチャネル、トリプルチャネルはメモリインターリーブの一例であり、2個ないし3個のバンクを同期して読み書きすることで高速化を図っている。しかしながらメモリインターリーブとはより包括的な概念であり、各バンクの読み書きは完全に同期している必要はなく、いくらかのズレがあってもよい。富士通PRIMEPOWERで実装されているメモリインターリーブ機構は、各バンクの読み込みについてそれぞれが完了するまでの時間内に次のアクセスをオーバーラップさせながら行う。例えば4バンクを順に読んだ場合24クロック必要のところが15クロックまで短縮できることが概念図で示されている。いずれにおいても各バンクのメモリは協調させながら読み書きを行う必要がある。そのため、メモリモジュールの駆動周波数および容量については同一、もしくは著しい制限があり、通常各バンクは同じ駆動周波数、同一容量であることが要求される。==出典・脚注== ） ： ウィキペディア日本語版 メモリインターリーブ（）とは、主記憶装置とCPUとの間のデータ転送を高速化する方法の一つである。CPUの処理速度と比較し、主記憶装置へのアクセス時間は遅い。そのため、CPUからのデータ転送要求が行われてから実際にデータが転送終了されるまでの間、処理が待たされることになり、CPUの処理能力を十分に発揮できない。それを解消するために、主記憶装置を複数のメモリバンクに分割し、CPUからのデータ転送要求を同時に（またはごく短いタイムラグをはさんで）複数のメモリバンクに発行する。それにより、CPUの待ち時間を極小化し、高速化することができる。2010年現在のパソコンで広く使われているデュアルチャネル、トリプルチャネルはメモリインターリーブの一例であり、2個ないし3個のバンクを同期して読み書きすることで高速化を図っている。しかしながらメモリインターリーブとはより包括的な概念であり、各バンクの読み書きは完全に同期している必要はなく、いくらかのズレがあってもよい。富士通PRIMEPOWERで実装されているメモリインターリーブ機構は、各バンクの読み込みについてそれぞれが完了するまでの時間内に次のアクセスをオーバーラップさせながら行う。例えば4バンクを順に読んだ場合24クロック必要のところが15クロックまで短縮できることが概念図で示されている。いずれにおいても各バンクのメモリは協調させながら読み書きを行う必要がある。そのため、メモリモジュールの駆動周波数および容量については同一、もしくは著しい制限があり、通常各バンクは同じ駆動周波数、同一容量であることが要求される。==出典・脚注==[ちょうおん] メモリインターリーブ（）とは、主記憶装置とCPUとの間のデータ転送を高速化する方法の一つである。 CPUの処理速度と比較し、主記憶装置へのアクセス時間は遅い。そのため、CPUからのデータ転送要求が行われてから実際にデータが転送終了されるまでの間、処理が待たされることになり、CPUの処理能力を十分に発揮できない。 それを解消するために、主記憶装置を複数のメモリバンクに分割し、CPUからのデータ転送要求を同時に（またはごく短いタイムラグをはさんで）複数のメモリバンクに発行する。それにより、CPUの待ち時間を極小化し、高速化することができる。 2010年現在のパソコンで広く使われているデュアルチャネル、トリプルチャネルはメモリインターリーブの一例であり、2個ないし3個のバンクを同期して読み書きすることで高速化を図っている。 しかしながらメモリインターリーブとはより包括的な概念であり、各バンクの読み書きは完全に同期している必要はなく、いくらかのズレがあってもよい。 富士通PRIMEPOWERで実装されているメモリインターリーブ機構は、各バンクの読み込みについてそれぞれが完了するまでの時間内に次のアクセスをオーバーラップさせながら行う。例えば4バンクを順に読んだ場合24クロック必要のところが15クロックまで短縮できることが概念図で示されている。 いずれにおいても各バンクのメモリは協調させながら読み書きを行う必要がある。そのため、メモリモジュールの駆動周波数および容量については同一、もしくは著しい制限があり、通常各バンクは同じ駆動周波数、同一容量であることが要求される。 ==出典・脚注== 抄文引用元・出典: フリー百科事典『 ウィキペディア（Wikipedia）』 ■ウィキペディアで「メモリインターリーブ（）とは、主記憶装置とCPUとの間のデータ転送を高速化する方法の一つである。CPUの処理速度と比較し、主記憶装置へのアクセス時間は遅い。そのため、CPUからのデータ転送要求が行われてから実際にデータが転送終了されるまでの間、処理が待たされることになり、CPUの処理能力を十分に発揮できない。それを解消するために、主記憶装置を複数のメモリバンクに分割し、CPUからのデータ転送要求を同時に（またはごく短いタイムラグをはさんで）複数のメモリバンクに発行する。それにより、CPUの待ち時間を極小化し、高速化することができる。2010年現在のパソコンで広く使われているデュアルチャネル、トリプルチャネルはメモリインターリーブの一例であり、2個ないし3個のバンクを同期して読み書きすることで高速化を図っている。しかしながらメモリインターリーブとはより包括的な概念であり、各バンクの読み書きは完全に同期している必要はなく、いくらかのズレがあってもよい。富士通PRIMEPOWERで実装されているメモリインターリーブ機構は、各バンクの読み込みについてそれぞれが完了するまでの時間内に次のアクセスをオーバーラップさせながら行う。例えば4バンクを順に読んだ場合24クロック必要のところが15クロックまで短縮できることが概念図で示されている。いずれにおいても各バンクのメモリは協調させながら読み書きを行う必要がある。そのため、メモリモジュールの駆動周波数および容量については同一、もしくは著しい制限があり、通常各バンクは同じ駆動周波数、同一容量であることが要求される。==出典・脚注==」の詳細全文を読む スポンサード リンク 翻訳と辞書 : 翻訳のためのインターネットリソース Copyright(C) kotoba.ne.jp 1997-2016. All Rights Reserved.