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差動増幅回路(さどうぞうふくかいろ、英: Differential amplifier)とは、2つの入力信号の差分を一定係数(差動利得)で増幅する増幅回路である。差動増幅回路はオペアンプ、コンパレータやエミッタ結合論理(ECL)ゲートの入力段として使われる。 == 概要 == 2つの入力 と が与えられたとき、実際の差動増幅回路の出力 は次のように表される。 ここで、 は差動利得、 は同相利得である。差動利得と同相利得の比を同相信号除去比(CMRR)と呼ぶ。 上の式で、 がゼロに近づくと は無限大に近づくことがわかる。電流源の抵抗 が高いほど が低くなり、 が改善される。従って、完全に対称的な差動増幅回路で なら、出力電圧は次のようになる。 抄文引用元・出典: フリー百科事典『 ウィキペディア(Wikipedia)』 ■ウィキペディアで「差動増幅回路」の詳細全文を読む 英語版ウィキペディアに対照対訳語「 Differential amplifier 」があります。 スポンサード リンク
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